コベリティジャパン株式会社のASIC Digital Design Engineer, Staff -Sr Staff求人

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※「正式に応募する」は、職務経歴書、履歴書が必要です。個人設定よりご登録をお願いします。

尚、カジュアル面談は保証されているものではなく不成立になる場合もございますのでご了承ください。

仕事内容

私たちは、シノプシスのデジタルデザインエンジニアとして、業界標準および機能仕様を理解し、複雑なプロトコルIPコアのアーキテクチャとマイクロアーキテクチャの定義に貢献します。Verilog/SystemVerilogでのデジタルブロックとサブシステムの設計・実装を行い、性能、面積、消費電力、テスト容易性のバランスを取りながら、基本的な検証や検証チームとのテスト計画、アサーション開発、機能デバッグ、カバレッジ閉鎖を協力して進めます。RTL開発中にはRTLレベルのタイミング解析を実施し、実装チームと協力して STA、タイミング制約、合成を行います。CDC/RDC/Lintのサインオフ準備をサポートし、デザインクオリティの閉鎖に協力します。また、AI駆動の設計ツールや手法を活用し、設計の質と自動化を向上させます。この業務を通じて、シノプシスのIPとして世界中の半導体企業に利用される製品の品質と市場投入までの時間に直接的に影響を与えます。私たちのチームは、協力による早期の問題発見を促し、コストのかかる再作成や遅い段階での修正を削減します。自動化を構築することで、チーム全体の設計生産性を向上させます。

募集要項

勤務地	-
給与	-
勤務時間	-
休暇制度	-
待遇・福利厚生	- Comprehensive range of health, wellness, and financial benefits - Monetary and non-monetary offerings - Details about the salary range and benefits will be provided during the hiring process
リモートワーク	-
その他	- 応募要件: Bachelor’s or Master’s degree in Electrical Engineering, Computer Engineering, or a related field4~15+ years of experience in digital design and/or RTL developmentHands-on experience designing and implementing synthesizable RTL in Verilog/SystemVerilog, with understanding of performance, area, power, and testability tradeoffsExperience with test planning, assertion development, basic verification, functional debug, and coverage closureExperience performing RTL-level timing analysis, with practical understanding of STA, timing constraints, and synthesisExperience with CDC/RDC/Lint signoff-ready design practices and design-quality closureScripting experience in Python, Tcl, Perl, or ShellWritten and oral communication skills in English and Japanese, with the ability to collaborate effectively across teams - 望ましい経験: Direct experience with PCIe or CXL IP design and developmentExperience with low-power design and power intent development using UPFExposure to UVM or formal verification conceptsExposure to functional safety concepts, ISO 26262, or FMEDAExperience mentoring engineers or serving as a technical lead on RTL/IP development projectsPrior experience in a global product engineering environment

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