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コベリティジャパン株式会社のASIC Digital Design , Staff Engineer求人

コベリティジャパン株式会社

職種
―
年収
―
エリア
東京

※「正式に応募する」は、職務経歴書 、履歴書 が必要です。個人設定よりご登録をお願いします。

尚、カジュアル面談は保証されているものではなく不成立になる場合もございますのでご了承ください。


仕事内容

私たちは、最先端の半導体ソリューションを設計・開発するハードウェアエンジニアとして、DesignWare IPコア用のUVMベースの検証環境の構築と保守を担当します。具体的には、USB、PCI Express、Ethernet、およびAMBAプロトコルに対応したテストプランを作成し、仕様の分析を通じてカバレッジのギャップを特定し、検証戦略を定めます。また、SystemVerilogを用いてテストベンチ、制約ランダムテスト、指示テスト、機能カバレッジモデルを作成し、高品質なメトリクスを達成します。RTLやテストベンチのデバッグは、VCS、NC、またはMTIシミュレータを用いて行い、デザインエンジニアと協力して問題の根本原因を解決します。さらに、リグレッション管理やカバレッジレポートの分析を通して、機能とコードカバレッジのギャップを閉じ、IPのサインオフ品質を実現します。グローバルな検証チームと連携し、レビューに参加し、DesignWare IPポートフォリオ全体で手法の改善に貢献します。

この業務を通じて、私たちはSoC設計において重要な役割を果たす高品質なDesignWare IPコアを提供し、テープアウト前に重大なバグを捕捉することでコストのかかる再設計を減らし、Synopsysの評判を守ります。また、自動車、モバイル、データセンター、AI市場向けの高ボリュームアプリケーションに対応したIPのカバレッジクロージャーと検証サインオフを進め、顧客の市場投入時間を短縮します。さらに、設計者との早期のフィードバックや計画レビューを通じて設計の質を向上させ、業界で最も広範なIPポートフォリオを支える検証プロセスと環境の拡張に貢献します。

募集要項

勤務地Bengaluru, Karnataka, India
給与-
勤務時間-
休暇制度-
待遇・福利厚生-
リモートワーク-
その他- **応募要件**: Bachelor's or Master's in Electrical Engineering or Computer Engineering with 5+ years of hands-on verification experience for IP cores or SoC designs (or Master's with 3+ years)
- **望ましい経験**: Strong SystemVerilog and HVL coding skills with proven ability to build testbenches, write constrained-random tests, and implement functional coverage
Direct experience with UVM, VMM, or OVM methodologies applied to real verification projects
Hands-on proficiency with industry-standard simulators such as VCS, NC (Xcelium), or MTI (Questa) and their associated debugging tools
Solid understanding of functional coverage and code coverage concepts, and how to use them to drive verification closure
Experience with Verilog for reading and understanding RTL is highly desired
Familiarity with scripting languages like Perl or Python for automation and regression management is a strong plus

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