コベリティジャパン株式会社のDigital Design Engineer Apprenticeship求人
コベリティジャパン株式会社
- 職種
- ―
- 年収
- ―
- エリア
- 東京
※「正式に応募する」は、職務経歴書 、履歴書 が必要です。個人設定よりご登録をお願いします。
尚、カジュアル面談は保証されているものではなく不成立になる場合もございますのでご了承ください。
仕事内容
Our internship program invites you to engage in real-world engineering tasks centered around the development and maintenance of UVM-based testbenches used for the functional verification of digital blocks in Serdes PHYs. You will collaborate with global teams to enhance your skills in creating and executing test cases, sequences, checkers, and assertions necessary for verifying RTL functionality. Ensuring protocol compliance in Serial Links will be a primary focus, where analyzing simulation results and debugging test failures are essential tasks. You will work closely with design engineers to pinpoint and rectify functional issues, which contributes significantly to producing high-quality designs. Additionally, your role involves supporting coverage-driven verification efforts by developing functional coverage models and monitoring verification metrics. This aids in the overall improvement of design quality. These tasks not only enhance your technical expertise but also integrate you into a culture that prioritizes innovation and collaboration.
募集要項
| 勤務地 | - Location: Noida, India |
|---|---|
| 給与 | - |
| 勤務時間 | - |
| 休暇制度 | - |
| 待遇・福利厚生 | - |
| リモートワーク | - |
| その他 | - **応募要件**: Completed Bachelor's degree in Electronics and Communication Engineering, Electrical or a related field (Mandatory). Fresh graduates from the class of 2026 or 2025. Not currently enrolled / completed any M-Tech programs or postgraduate diplomas. Not employed in any full-time positions at any company (limited internship experience is acceptable). Strong digital electronics fundamentals. Proficiency in Verilog and SystemVerilog, you have written RTL/Testbenches. - **望ましい経験**: Exposure to functional verification methodologies like UVM, OVM, or VMM is a plus. Theoretical knowledge of protocols such as PCIe is a plus. |
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